Here is a list of all struct and union fields with links to the structures/unions they belong to:

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• ~AstModule() : AST::AstModule
• ~AstNode() : AST::AstNode
• ~Backend() : Backend
• ~BigUnsigned() : BigUnsigned
• ~BigUnsignedInABase() : BigUnsignedInABase
• ~CaseRule() : RTLIL::CaseRule
• ~Design() : RTLIL::Design
• ~DesignPass() : DesignPass
• ~destruct_guard_t() : RTLIL::IdString::destruct_guard_t
• ~ezMiniSAT() : ezMiniSAT
• ~ezSAT() : ezSAT
• ~Frontend() : Frontend
• ~IdString() : RTLIL::IdString
• ~LibertyAst() : Yosys::LibertyAst
• ~LibertyParser() : Yosys::LibertyParser
• ~Map() : Minisat::Map< K, D, H, E >
• ~ModIndex() : ModIndex
• ~Module() : RTLIL::Module
• ~Monitor() : RTLIL::Monitor
• ~NumberlikeArray() : NumberlikeArray< Blk >
• ~ObjIterator() : RTLIL::ObjIterator< T >
• ~Option() : Minisat::Option
• ~Pass() : Pass
• ~Process() : RTLIL::Process
• ~RegionAllocator() : Minisat::RegionAllocator< T >
• ~SigMap() : SigMap
• ~SimpSolver() : Minisat::SimpSolver
• ~Solver() : Minisat::Solver , SubCircuit::Solver
• ~stackmap() : stackmap< Key, T, Compare >
• ~StreamBuffer() : Minisat::StreamBuffer
• ~SwitchRule() : RTLIL::SwitchRule
• ~vec() : Minisat::vec< T, _Size >
• ~Wire() : RTLIL::Wire